NI LabVIEW 和 LabVIEW FPGA 模塊為 NI Reconfigurable I/O (RIO) 硬件目標(biāo)上的 FPGA 設(shè)備提供圖形化開(kāi)發(fā)。用戶(hù)可以創(chuàng)建嵌入式 FPGA VI，將直接訪問(wèn) I/O 與用戶(hù)定義的 LabVIEW 邏輯相結(jié)合，以定義自定義硬件。

雖然 LabVIEW 是 FPGA 編程的有效工具，但用戶(hù)可能擁有現(xiàn)有的硬件描述語(yǔ)言 (HDL) 知識(shí)產(chǎn)權(quán) (IP)，他們必須將其集成到他們的 NI FlexRIO 硬件應(yīng)用程序中。這樣做有三個(gè)選項(xiàng)。一個(gè)選項(xiàng)是 IP 集成節(jié)點(diǎn)。該節(jié)點(diǎn)為 HDL IP 和 Xilinx CORE Generator XCO 文件提供了一個(gè)簡(jiǎn)單的內(nèi)聯(lián)接口。它具有自動(dòng) LabVIEW 接口生成功能，并能夠?yàn)橹鳈C(jī)執(zhí)行生成周期準(zhǔn)確的仿真模型。使用新功能，用戶(hù)可以在主機(jī)上運(yùn)行他們的 LabVIEW FPGA VI，以確保在為 FPGA 編譯之前確保功能正常

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